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可测性设计工程师(DFT)
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可测性设计西安紫光国芯半导体有限公司西安07-17

学历要求:本科|工作经验:|公司性质:国企|公司规模:

岗位职责:DFT电路设计、实现及验证,芯片测试及失效分析岗位要求:具备数字电路基本知识,DFT 基本概念

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资深DFT(可测性设计)工程师芯原微电子(成都)有限公司成都-高新区07-17

学历要求:硕士|工作经验:2年|公司性质:外资(欧美)|公司规模:150-500人

咔咔彩票职位描述:完成DFT测试方案的制定;完成DFT逻辑设计,包括:存储器内建自测试、存储器内建自修复、扫描链插入、边界扫描链插入、宏测试;完成DFT测试向量的验证;完成DFT模式时序约束,帮助DFT模式时序收敛;帮助芯片Bring-up,完成测试向量的调试,良率的提升;为客户、现场应用工程师、销售人员提供技术支持。职位要求:电子工程硕士及以上学历,至少2年DFT工作经验;或者电子工程学士学历,至少5年DFT工作经验;具备以下经验:测试方案的制定,存储器内建自测试、存储器内建自修复、扫描链插入、边界扫描链插入、宏测试的逻辑设计及验证,分析ATE测试向量的故障并做诊断;熟练使用Mentor/Synopsys DFT EDA工具;具备熟练英文读写能力和基本听说能力;富有事业心和团队合作精神,沟通表达能力良好;具备后端综合、布局布线、静态时序分析经验者优先。Responsibilities:Complete DFT test plan definition.Complete DFT logic design, including: memory BIST, memory BISR, scan insertion, boundary scan insertion, macro testing.Complete DFT test pattern verification.Complete DFT mode timing constraint, support DFT mode timing closure.Support chip bring-up, complete test pattern debugging, yield improvement.Provide technical support for customer/FAE/sales. Requirements:Master of EE, 2+ years' DFT work experiences or Bachelor of EE, 5+ years' DFT work experiences.Have following experiences: test plan definition, memory BIST, memory BISR, scan insertion, boundary scan insertion, macro testing logic design and verification, analyze ATE test pattern failure and perform diagnose.Have back-end Synthesis, P&R, STA experiences is a plus.Be able to skillfully use the Mentor/Synopsys DFT EDA tools.Full of enterprise and the spirit of teamwork, good ability to communicate and express, fluent in Mandarin and English.

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Staff DFT Engineer-可测性设计美满电子科技(Marvell)南京-雨花台区07-14

学历要求:硕士|工作经验:3-4年|公司性质:外资(欧美)|公司规模:500-1000人

职责描述:1.Implement modern DFT solutions for leading edge ICs on latest technology nodes2.Understand and then implement the Marvell DFT architecture3.Work with RTL, verification, physical implementation, and timing teams during this DFT implementation.4.Set-up, run, and debug IP-level ATPG runs5.Integrating the scripts and Makefile into a unified DFT flow任职要求:1.Hands-on experience with scan test, logic and memory BIST/BISR, functional test, JTAG, and other test methodologies2.Strong background in industry standard scan test (including scan compression) and memory BIST/BISR tools3.Experience and knowledge of Synthesis, IC routing and static timing tools4.Experience and knowledge of functional verification, especially of DFT features5.Experience and knowledge of modern JTAG standards and implementation6.Proficiency with programming and scripting languages such as Perl/TCL Preferred/Plus7.Experience with board/bench debug features and capabilities strongly desired Other Skills8.Must have effective interpersonal and teamwork skills.9.Proficiency in working with cross functional and cross site teams.10.Excellent communication skills11.Demonstrates good analysis and problem-solving skills.12.Has an inherent sense of urgency and accountability13.Must have the ability to multi-task in a fast-paced environment14.Bachelor's degree or equivalent in Computer Science, Electrical Engineering or related fields with 3-5 years of related professional experience.Master’s degree and/or PhD in Computer Science, Electrical Engineering or related fields preferred.

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测试工程师浙江信雅达文化艺术发展有限公司杭州-滨江区0.8-1万/月07-17

学历要求:大专|工作经验:2年|公司性质:民营公司|公司规模:少于50人

职位描述1、参与产品的设计与测试过程:产品需求,功能设计,产品可测性设计与反馈,单元测试,系统测试,性能测试;2、参与构建研发体系的持续集成环境及自动化测试平台的研发,参与产品线特色化的测试框架;3、负责需求用例、测试用例、使用指南等项目文档的编写以及跟进工作;职位要求1、大专及以上学历,1年以上测试经验;2、有教育培训行业测试工作经验。

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高级DFT工程师上海东软载波微电子有限公司苏州-工业园区07-17

学历要求:本科|工作经验:5-7年|公司性质:民营公司|咔咔彩票公司规模:150-500人

岗位职责内容:1、负责项目的测试计划、测试结构定义,编写测试SPEC;2、负责DFT电路的实现和验证,并优化完善DFT设计流程,包括MBIST、SCAN、boundary scan、ATPG以及其他可测性电路设计;3、负责开发高覆盖率和低测试成本的测试pattern;4、协助数字设计工程师,完成数字前端设计流程,包括DC、FM、STA、功耗分析等;5、配合物理设计工程师,完成DFT相关的STA/Power等方面的Signoff;6、配合测试工程师,协助完成ATE机台测试failure 诊断并提供解决方法。相关技能要求:1、精通DFT技术和设计流程;2、精通测试pattern仿真、芯片测试、良率分析及debug;3、熟悉主流EDA工具;4、熟悉数字逻辑设计、综合、静态时序分析;5、掌握shell/TCL/Perl/Python脚本语言;6、了解CP/FT测试流程;7、优秀的职业素养,良好的沟通和协调能力,良好的团队意识和合作精神。工作经历要求:能独立完成大规模集成电路DFT与实现,并有成功流片经历。

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DFT、ATE工程师龙芯中科技术有限公司北京07-17

学历要求:本科|工作经验:|公司性质:民营公司|公司规模:

岗位职责: 1、制定芯片测试方案,编写测试文档; 2、完成芯片可测性逻辑设计; 3、配合物理设计工程师完成芯片物理设计时序收敛; 4、配合测试厂完成芯片测试的调试工作。 任职资格: 1、本科以上,电子、计算机相关专业;两年以上DFT工作经验; 2、熟悉Verilog语言,能熟练完成RTL代码的可测性设计,包括:Scan、MBIST、BSD、ATPG等; 3、熟悉主流可测性设计EDA工具 ; 4、熟悉LINUX操作系统,熟练使用Tcl、Perl、Shell编程语言; 5、熟悉超大规模集成电路可测性设计,了解深亚微米芯片工艺及可测性设计流程,具有成功流片经验; 6、热爱DFT工作,有较强的学习和分析处理问题的能力,有较好的沟通能力和团队合作精神; 7、了解芯片CP/FT测试流程者优先。

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DFT工程师杭州旗捷科技有限公司杭州-滨江区1.5-2.5万/月07-17

学历要求:本科|工作经验:3-4年|公司性质:上市公司|公司规模:150-500人

1、负责DFT测试策略的制定和实现;2、负责DC综合和Scan chain插入;3、负责整个DFT设计和验证自动化流程及最终量产测试的向量产生和验证。岗位要求:1、电子相关专业本科以上学历,拥有3年以上工作经验;2、熟悉数字IC设计流程,熟练掌握DC、PT、ATPG等工具,熟悉半导体物理;3、具有分析,追踪和解决覆盖率损失、仿真错误、ATE测试失效等问题的能力;4、拥有DFT设计实际项目的经验者优先考虑。

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数字前端设计工程师灿芯半导体(上海)有限公司合肥-高新区2.5-4万/月07-17

学历要求:本科|工作经验:2年|公司性质:外资(非欧美)|咔咔彩票公司规模:150-500人

咔咔彩票1.负责数字前端设计和验证; 2.负责进行RTL代码编写、仿真验证、综合、时序分析、可测性设计; 3.配合后端工程师完成布局布线; 4.负责芯片设计项目中数字前端设计开发工作,包括RTL设计、RTL验证、形式验证、RTL综合、时序验证等工作,实现芯片功能、性能要求; 5.熟练使用数字IC设计的EDA工具,包括仿真、综合、时序分析等; 6.指导设计测试方案,并协助对芯片样片进行测试评估; 7.负责相关技术文档编写。   1.熟悉数字IC设计流程,有3年以上工作经验者优先; 2.熟练Verilog代码编写,了解逻辑综合、静态时序分析、后端物理实现及形式验证等; 3.熟悉VCS、NC-Verilog、Vivado、DC、PT、Formality等EDA工具; 4.具有DDR、USB、MIPI等设计经验者优先; 5.具有流片经验者优先; 6.主动性强,有责任心,做事认真仔细,良好的团队合作精神。

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高级/数字IC设计工程师晶门科技(中国)有限公司深圳-南山区18-30万/年07-17

学历要求:本科|工作经验:5-7年|公司性质:外资(非欧美)|公司规模:50-150人

咔咔彩票职位描述:- 进行逻辑综合、可测性设计、静态时序分析、布局与布线、工艺库特性分析; - 支持ATPG和功能测试程序开发,测试覆盖率分析; - 支持其他版图设计及验证工作; - 支持晶圆级测试和工艺评估;职位要求:- 本科或以上学历,电子信息工程或相关专业; - 5年或以上丰富的芯片数字设计经验; - 具备逻辑综合、布局规划、布局与布线、提取时序、版图验证的工作经验; - 对约束生成、静态时序分析、时序优化和时序/信号完整性收敛有深刻的理解; - 具有多域电源设计经验; - 了解IR/EM收敛; - 丰富的流程定制和效率脚本技能; - 积极主动,有良好的持续学习、团队合作和沟通能力,对工作有兴趣和热情。

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芯片设计工程师山东领能电子科技有限公司济南-高新区0.6-1.8万/月07-17

学历要求:本科|工作经验:2年|公司性质:民营公司|公司规模:少于50人

咔咔彩票工作职责 1、负责数字/模拟芯片开发和设计、验证、实现工作; 2、按照模块规格和芯片总体方案的要求,严格遵循开发流程、模板、标准和规范,承担模块的详细设计和实施工作,确保开发工作按时按质完成; 3、及时编写各种设计文档和标准化资料,实现资源、经验共享。 职位要求 1、微电子、计算机、通信工程等相关专业 2、了解或实际应用过VHDL/Verilog语言编程,了解UVM验证方法和流程,掌握数字电路设计,或具有FPGA设计经验,或熟悉综合(SYN)/时序分析(STA)/布局布线(Place and routing)/可测性设计(DFT),有相关工具应用的经验;或具有数字/模拟IC设计项目经验,或者嵌入式系统设计经验 

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ATE工程师上海傅硅电子科技有限公司上海-徐汇区1.5-2.5万/月07-17

学历要求:本科|工作经验:1年|公司性质:创业公司|公司规模:少于50人

岗位职责:1. 与芯片研发工程师沟通芯片的可测性设计;2. 设计CP、FT测试电路板,搭建ATE测试平台,与厂商合作制作Load Board、Probe Card、Socket等测试硬件;3. 根据测试规范,开发测试程序、工程验证、调试、测试程序确认报告;4. 对测试程序不断分析与优化,确保测试覆盖率、测试稳定性、一致性以及测试时间达到预期目标,并提高测试效率;5. 协助生产线顺利生产,与其它相关部门进行沟通和互动,完成上级交给工作任务,以达到保证产品质量,降低制造成本的目标;6. 测试程式版本管理及批量生产的管理。任职要求:1.  微电子,自动化等相关专业,本科以上学历;2.  1年以上IC测试开发工作经验;3.    有Chroma&CTA8280&ACCO8200测试开发经验优先;4. 具备模拟电路和PCB设计经验;5. 良好的C/C++/C#编程能力;6. 工作负责,做事积极主动,学习能力强,能够吃苦耐劳;7. 良好的人际沟通协调能力,富有团队精神。

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测试/测试开发实习生 — 有转正机会字节跳动深圳0.9-1.8万/月07-17

学历要求:本科|工作经验:在校生/应届生|公司性质:民营公司|咔咔彩票公司规模:10000人以上

职位描述:1、参与头条相关产品的研发与测试过程;2、参与产品需求、功能设计、产品可测性设计与反馈,致力于提高产品的技术可靠性和用户体验。职位要求:1、计算机相关专业;2、有移动互联网测试经验,有自动化或白盒测试经验优先考虑;3、热爱互联网,对互联网相关业务或技术充满好奇及热情;?4、具备快速的产品及业务学习能力、敏捷而周到的逻辑思维能力;5、每周可实习4天以上,可实习3个月以上。

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数字IC工程师厦门润积集成电路技术有限公司异地招聘0.7-1.2万/月07-17

学历要求:本科|工作经验:1年|公司性质:民营公司|公司规模:少于50人

岗位职责:1、基于verilog语言的数字设计,验证,综合,仿真以及静态时序分析等;2、串行接口电路设计,如I2C, SPI等;3、可测性设计,包括扫描链插入,测试模式生成等;4、评估和鉴定IC‘s以及它们的演示板;5、协助完成混合信号ASIC设计流程的各种工作,如设计、验证、综合、布局、布线、测试、LVS、DRC等;6、协助对客户应用的支持。任职要求:1、电子科学与技术、微电子、集成电路设计等相关专业,本科及以上学历;2、有团队协作意识,善于沟通,工作踏实,责任心强;3、较好的英语阅读写作能力。有以下经验者优先:1、有串行接口设计经验,如SPI, SMBUS, I2C master/slave等;2、有高速数字设计的相关经验(Semi-flow: customer layout + ASIC flow);3、具有扎实的数字电路模块知识,尤其是高速异步电路设计;4、擅长Verilog RTL代码、验证和调试;5、EDA工具的实践经验,如Cadence NC-Sim, Synopsys DC, PT等;6、电子科学与技术、微电子、集成电路设计等相关专业,硕士及以上学历。薪酬福利:1、行业内极具竞争力的薪资待遇;岗位晋升;2、缴交五险一金;为员工购买意外伤害险;职工医疗互助保障;3、带薪年假、法定节假日正常休假;4、住房补贴(外地员工)、高温补贴、节日福利、年度体检、生日福利、全勤奖、结婚礼金、生育礼金、中秋博饼、年终尾牙等活动;5、舒适的工作环境,极具活力与激情的工作氛围;6、未来股权激励。

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DFT工程师上海途擎微电子有限公司上海-浦东新区2.5-3万/月07-17

学历要求:本科|工作经验:3-4年|公司性质:上市公司|咔咔彩票公司规模:150-500人

岗位职责: 1, 参与SOC/IP DFT架构规划, 包含design、implementation、ATPG、pattern simulation、diagnosis等。 2,独立完成和维护block 的DFT实现工作,scan insertion/MBIST/compression/OCC等, 3,分析DFT相关的PPA(Performance,Power,Area)。 4,研究SOC/IP最先进的DFT架构和方法学技术。 5,开发新的DFT流程和in-house方案,并应用到SOC/IP。 6,协助解决SOC在DFT implementation & silicon test过程中遇到的问题。 7,可以独立完成DFT模式的LEC/CLP/STA/ECO等工作。 任职要求: 1,计算机/电子信息工程相关专业,本科及以上学历,1-3年ASIC领域工作经验; 2,熟悉verilog和ASIC前端设计流程; 3,具备可测性设计理论知识和概念; 4,对synopsys/Mentor的DFT 工具有一定的认识; 5,对ATPG/MBIST diagnosis有经验者,或者对Yield分析有经验者是极大的加分项; 6,熟悉脚本开发 Makefile/Tcl/Perl/Python等. 7,为人正直,守信,有责任心和团队合作精神,有较强的抗压能力。

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数字IC设计工程师无锡市人力资源市场无锡-滨湖区1-1.8万/月07-17

学历要求:硕士|工作经验:在校生/应届生|公司性质:事业单位|公司规模:150-500人

1.负责数字集成电路的设计及其相关算法实现和验证; 2.负责进行电路RTL代码编写、仿真验证、综合、时序分析、可测性设计; 3.配合后端工程师完成布局布线; 4.负责芯片设计项目中数字前端设计开发工作,包括RTL设计、RTL验证、形式验证、RTL综合、时序验证、DFT/ATPG等工作,实现芯片功能、性能要求; 5.熟练使用数字IC设计的EDA工具,包括仿真、综合、时序分析等; 6.指导版图设计并进行相关检查和后仿真; 7.指导设计测试方案,并协助对芯片样片进行测试评估; 8.负责相关技术文档编写。 岗位要求: 1.熟悉数字IC设计流程; 2.熟练Verilog代码编写,了解逻辑综合、静态时序分析、后端物理实现及形式验证等; 3.熟悉VCS、NC-Verilog、ISE、DC、PT、Formality等EDA工具; 4.具有SerDes、DDS、数字上下变频器设计经验者优先; 5.具有流片经验者优先; 6.主动性强,有责任心,做事认真仔细,良好的团队合作精神。

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ATE工程师飞勾(上海)信息科技有限公司上海2-2.5万/月07-17

学历要求:本科|工作经验:1年|公司性质:民营公司|公司规模:

岗位职责:1. 与芯片研发工程师沟通芯片的可测性设计;2. 设计CP、FT测试电路板,搭建ATE测试平台,与厂商合作制作Load Board、Probe Card、Socket等测试硬件;3. 根据测试规范,开发测试程序、工程验证、调试、测试程序确认报告;4. 对测试程序不断分析与优化,确保测试覆盖率、测试稳定性、一致性以及测试时间达到预期目标,并提高测试效率;5. 协助生产线顺利生产,与其它相关部门进行沟通和互动,完成上级交给工作任务,以达到保证产品质量,降低制造成本的目标;6. 测试程式版本管理及批量生产的管理。任职要求:1.  微电子,自动化等相关专业,本科以上学历;2.  1年以上IC测试开发工作经验;3.  有Chroma&CTA8280&ACCO8200测试开发经验优先;4. 具备模拟电路和PCB设计经验;5. 良好的C/C++/C#编程能力;6. 工作负责,做事积极主动,学习能力强,能够吃苦耐劳;7. 良好的人际沟通协调能力,富有团队精神。

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122215DFT工程师深圳市大疆创新科技有限公司上海-浦东新区2.5-4万/月07-17

学历要求:本科|工作经验:3-4年|公司性质:民营公司|公司规模:10000人以上

1. 参与制定完整的SoC芯片DFT方案;2. 完成DFT电路设计,包括Scan、Mbist、Bscan、Lbist;3. 完成DFT模式的时序约束,协助完成DFT模式的时序收敛;4. 完成DFT电路的功能验证;5. 参与芯片bring-up调试;6. 参与芯片的良率提升以及故障分析。职位要求:1. 硕士要求至少2年DFT工作经验,本科要求至少4年DFT工作经验;2. 熟悉DFT电路结构,包括Scan、Mbist、Bscan、Lbist;3. 熟练使用DFT设计工具,具备Spyglass者优先;4. 具备高可靠性或低DPPM芯片DFT设计经验者优先;5. 具备RTL代码编写、验证、综合及静态时序分析经验者优先;6. 富有事业心和团队精神,沟通表达能力良好,良好的英文读写能力。

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数字集成电路设计宁波爱芯微电子有限公司成都-青羊区0.8-1.5万/月07-17

学历要求:本科|工作经验:2年|公司性质:民营公司|公司规模:少于50人

~本岗位无年龄要求,欢迎工作踏实的老工程师~1、负责数模混合芯片中数字电路的设计和验证;2、负责进行电路RTL代码编写、仿真验证、综合、时序分析、可测性设计;3、能够完成数字电路模块在FPGA上的验证,搭建MCU+FPGA的验证平台。4、指导设计测试方案,并协助对芯片样片进行测试评估;5、负责相关技术文档编写。岗位要求:1、本科以上学历,电子类相关专业,2年以上数字电路设计经验;2、熟悉Verilog语言,相关仿真工具(nc、vcs)及相关前端设计工具(Vi、Nc、Verdi、Vcs);3、了解数字后端设计流程及相关设计工具(Dc、Pt、Astro、Encounter、Formality), 有综合及时序分析的相关经验;4、英语四级或以上,具有阅读及编写英语技术文档的能力;5、主动性强,有责任心,做事认真仔细,有良好的团队合作精神。

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数字IC设计工程师(无锡)中科芯集成电路有限公司异地招聘15-40万/年07-17

学历要求:硕士|工作经验:在校生/应届生|公司性质:国企|咔咔彩票公司规模:1000-5000人

岗位职责:岗位职责:1.负责数字集成电路的设计及其相关算法实现和验证;2.负责进行电路RTL代码编写、仿真验证、综合、时序分析、可测性设计;3.配合后端工程师完成布局布线;4.负责芯片设计项目中数字前端设计开发工作,包括RTL设计、RTL验证、形式验证、RTL综合、时序验证、DFT/ATPG等工作,实现芯片功能、性能要求;5.熟练使用数字IC设计的EDA工具,包括仿真、综合、时序分析等;6.指导版图设计并进行相关检查和后仿真;7.指导设计测试方案,并协助对芯片样片进行测试评估;8.负责相关技术文档编写。 任职资格:1.熟悉数字IC设计流程;2.熟练Verilog代码编写,了解逻辑综合、静态时序分析、后端物理实现及形式验证等;3.熟悉VCS、NC-Verilog、ISE、DC、PT、Formality等EDA工具;4.具有SerDes、DDS、数字上下变频器设计经验者优先;5.具有流片经验者优先;6.主动性强,有责任心,做事认真仔细,良好的团队合作精神。

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Sr Digital Design Engineer (DFT)德州仪器半导体技术(上海)有限公司上海-浦东新区07-17

学历要求:硕士|工作经验:10年以上|公司性质:外资(欧美)|公司规模:150-500人

咔咔彩票About TITexas Instruments Incorporated (TI) is a global semiconductor design and manufacturing company that develops analog ICs and embedded processors. By employing the world’s brightest minds, TI creates innovations that shape the future of technology. TI is helping about 100,000 customers transform the future, today. We’re committed to building a better future – from the responsible manufacturing of our semiconductors, to caring for our employees, to giving back inside our communities and developing great minds. Put your talent to work with us – change the world, love your job! About the jobIn this position, you will be working on high-speed mixed-signal communication circuits using state-of-the art process technology, as well as be involved in the design of high performance digital circuits interfacing to leading edge analog circuitry as part of an overall system. Your responsibilities will include:- DfT architecture definition for whole SoC and digital/mixed signal IPs- DfT logic/circuit implementation for SoC- DfT pattern generation, simulations and debug (including setup creations, any required automation, etc.)- Overcome the different design and IP challenges to enable achieving all the structural coverage goals- Drive new techniques and methodologies to enable test time  and test cost reduction for the SoCs- SoC DfT verification in RTL and Gate Level- Responsible for driving the requirements with all the stakeholders- Lead DfT engineers to plan DfT work and complete as plannedMinimum requirements:- more than 10 years of relevant experience- A thorough understanding of mixed signal chip/IP level DfT- Understanding of DfT architecture like JTAG, SWD, Scan compression Techniques, scan chain insertion and verification, analog testing- Must have experience generating scan patterns and coverage statistics for various fault models like stuck at (Nominal and VBOX), IDDQ, Transition faults- Experience with gate level pattern simulations and debug- Exposure to debugging tester failures of scan patterns, diagnosis and pattern re-generation- Knowledge of at least any one of an industry standard DFT tools (Cadence Modus, Synopsys Tetramax, Mentor Tessent Tools, etc)- Good understanding of constraints development for Physical Design implementation / Static Timing Analysis- Design experience in MBIST is an added advantage- Exposure to post silicon debug is a plus- Excellent debugging and problem solving skills- Effective communication skills to interact with all stakeholders- Must be highly focused and remain committed to obtaining closure on project goals- Ability to solve problems using a systematic approach Preferred qualifications:- Demonstrated strong analytical and problem solving skills- Strong verbal and written communication skills- Ability to work in teams and collaborate effectively with people in different functions- Strong time management skills that enable on-time project delivery- Demonstrated ability to build strong, influential relationships- Ability to work effectively in a fast-paced and rapidly changing environment- Ability to take the initiative and drive for results To be considered for this position, please apply.

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